AUSBILDUNG

Signalintegrität: High-speed Speicherinterfaces

Beschreibung

Dieser Workshop ist für Entwickler, die High-Speed Speicherschnittstellen auf kundenspezifischen Boards implementieren wollen. Speicherschnittstellen werden sehr oft verwendet, sie werden schneller und schneller - und die Entwurfsprobleme werden mehr und mehr zu einer Herausforderung. Das Training ist für Entwickler geeignet, die nicht nur Schaltpläne entwerfen, sondern auch Systeme und Layout. Sie werden die entsprechenden Besonderheiten der Speicherbausteine für logische und physische Designs kennenlernen,  Zeit- und Spannungstoleranzen werden diskutiert. Sie werden lernen wie die Signalintegrität Simulation anzuwenden ist, um die High-Speed Speicherschnittstellen zu optimieren. IBIS Modelle und Simulation werden die Effekte und möglichen Problemzonen aufdecken. Der Workshop beinhaltet wie High-Speed Speicherschnittstellen implementiert werden, einschließlich Themen auf Board Ebene. Darüber hinaus werden die Stromversorgungsprobleme diskutiert und schließlich werden   Optionen zur Verifikation auf Board Ebene vorgestellt.

Agenda

  • Übersicht über die Arten von Speicherbausteinen
  • Details zu DDRx-Speicherbausteinen
  • Speichercontroller
  • Speicherschnittstellen-Design
  • Kurze Einführung in die Signalintegrität
  • Grundlagen zur SI Simulation von Speicherschnittstellen
  • SI Simulationsoptionen für Speicherschnittstellen
  • Verbesserung der Designtoleranzen durch Simulation
  • Verifizierung von Speicherschnittstellen
  • Design Richtlinien für die Speicherschnittstelle


Voraussetzungen: Hardware Design Grundkenntnisse   I Dauer: 2 Tage I Sprache: Deutsch I wahlweise Englisch I Preis: 1.250,00 EUR netto

Termine

  • 07. – 08.05.2019 | 9:00 – 17:00 Uhr | Berlin

Auf Anfrage können weitere Optionen wie Live Online und Vor-Ort Trainings angeboten werden.

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